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Tera-scale Computing
这一期的 Intel Technology Journal 主题是 Tera-scale Computing。
和常在总裁身边出现的光鲜亮丽的 Audrey 本名是 翠花，独享办公室而神气活现的 Ansel 被叫做 狗剩 一样，Tera-scale 在 Intel 内部毫无光环地叫做 many core－－many？多少算 many，80？80 也就 so so 吧。与此类似的还有 CSI－－据称 marketing name 要叫 QuickPath 了……好难听。
这组 Tera-scale 专题由 8 篇文章组成，在 architecture 和 application 两方面。60 年代起头的处理器革命让这个世界多了一个独立类目，人们开始在其上构建新型的商业社会，处理器不再跟计算器混淆分不清，而是成为媒体，通信和商务工具的基础－－这是上一波浪潮。在这期 ITJ 的 FOREWORD 里，几个作者认为，下一个 10 年期，处理器里有 2或4 核心不算什么了，数十个或者数百个核心的处理器才是常态。抛开如何做到这一点不说，如何利用好这样惊人的计算资源也是问题。和如今的计算机远超 ENIAC 一样，Terascale 的处理器可以提供过去的超级计算机才具有的能力。处理器之间会有 Tera 量级的 I/O 带宽，超常的核心间低延迟要求等等等等，这些属性都会催生今日难以想象的新型应用－－早期只能在字符界面做文字处理工作的用户看到今日绚烂易用的 GUI 环境和软件会怎样？
这样的“能力”上，正有多种类型的应用方兴未艾。比如 model-based 的，计算机可以逐步建立/获得关于“事物”的成熟 model，软件能从海量数据中识别，发现甚至合成真实/虚拟的人物，场景等实体－－别煞风景地提什么不搭界的 Matrix 或者 Second Life，否则你就是没吃过猪肉也没见过猪跑的猪头。这样的分析和处理能力可以让－－至少有物理基础让－－计算机达到那个我们曾经想象过却从未真正逼近的目标：成为我们可信赖的伙伴和顾问。从这个角度上说，Eric Schmidt 说未来 Google 可能成为人们问“我今儿该干什么”的入口是有些道理的。
前述的景象就是 Intel 的 Tera-scale Computing Research 计划的动机之一。这是 Intel 的事业，也是整个信息技术业界的事业，这样的变化隐含完全不同的挑战，architecture 设计需要考虑 数十/数百 核心的情况，能够有效管理和使用这样资源的系统软件和应用也和 Andy 在 Shawshank 的那把锤子一样起着决定性的作用。
并行或者多线程程序在传统的－－也就是过去多年以及现在的－－世界里也不错，不过没人要求必须，我们差不多都习惯了只要能 work 就行。这样的现状和思路是 terascale computing 面临的最大障碍，所以和大学开设合作课程传播 并行/多线程 程序设计最积极的正是 Intel。
这期的 8 篇文章讲述了相关的硬件设计，还有 Intel 提出的与其对应的适合的编程模式。有讲 datacenter-on-a-chip 的，一个原本运行在 133 颗处理器上的电子商务数据中心如何大挪移到一个 32 核心（每核心 4 线程） terascale 处理器上。此外还有对教科书上经典的 memory architecture 的更改，特别是 cache 部分，新构想是高带宽的 L4 cache，还有多线程如何优化使用共享 cache 空间。应用部分谈了游戏和电影中的虚拟现实，以及家庭多媒体数据的搜索与挖掘。
基于这些信息，有啥新动向呢？一是 L4 cache 的封装和集成；还有非 IA 芯片的集成；另外就是…这下有看头了…提供高带宽 memory 最后可能要 memory 直接上 die－－那么，很显然，集成 memory controller 在 die 或者 package 一级更早也会实现，比如 CSI－－AMD 又要笑了，又能拿出 HyperTransport 说事－－可惜，第一个下树的猴子诚然会引得猴群一片仰慕乃至部分母猴无限倾心，可猴子落地比 CNN 在中国大陆落地还难的情况持续不了多久，当到处都是下地的猴子后，谁还记得第一个？－－除非你再次与众不同。
ITJ 可从文首提及的 Intel 网站上免费下载。
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